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为减少平均访存时间,可以让容量较小的第一级Cache采用较小的块,而让容量较大的第二级Cache采用较大的块。
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考题
●设某流水线计算机主存的读/写时间为100ns,有一个指令和数据合一的Cache,已知该Cache的读/写时间为10ns,取指令的命中率为98%,取数的命中率为95%。在执行某类程序时,约有1/5指令需要存/取一个操作数。假设指令流水线在任何时候都不阻塞,则设置Cache后,每条指令的平均访存时间约为 (14) 。(14) A.12nsB.15 nsC.18 nsD.120ns
考题
高速缓存Cache与主存间采用全相联地址映像方式,高速缓存的容量为4MB,分为4块,每块1MB,主存容量为256MB。若主存读写时间为30ns,高速缓存的读写时间为3ns,平均读写时间为3.27ns,则该高速缓存的命中率为(1)%。若地址变换表中相联存储器的88H对应的cache块号为01B,则主存地址为8888888H时,高速缓存地址为(2)。(1)A.90B.95C.97D.99
考题
为了提高访存速度,在CPU与cache之间设置一个高速小容量的cache,存放正在执行的程序段,有效地提高了读存速度。写存时为了保持写入cache单元的内容与主存单元内容一致,通常采用两种方法(1)和(2).A.写直达法B.直接地址映像法C.写回法D.全相联地址映像法
考题
在Cache和主存构成的两级存储系统中,Cache的存取时间为100ns,主存的存取时间为1μs,Cache访问失败后CPU才开始访存。如果希望Cache-主存系统的平均存取时间不超过Cache存取时间的15%,则Cache的命中率至少应为()。A.95%
B.98%
C.98.5%
D.99.5%
考题
采用组相联映像的Cache存储器,为提高其等效性访问速度应()。A、增大主存容量(Cache大小不变)B、增加Cache的块数(块的大小不变)C、减小组的大小(块的大小不变)D、减小块的大小(组的大小不变)
考题
下面是对高速缓冲存储器(CAChe)的描述,正确的有()A、CAChe是位于CPU与主存储器之间,对用户是透明的一种高速小容量存储器B、在现代CPU设计技术中,常将CAChe分成一级CAChe和二级CACheC、一级CAChe容量一般较小,二级CAChe的容量相对一级CAChe要大一些D、高速缓存中存放的是正在运行的一小段程序和数据
考题
多选题下面是对高速缓冲存储器(CAChe)的描述,正确的有()ACAChe是位于CPU与主存储器之间,对用户是透明的一种高速小容量存储器B在现代CPU设计技术中,常将CAChe分成一级CAChe和二级CACheC一级CAChe容量一般较小,二级CAChe的容量相对一级CAChe要大一些D高速缓存中存放的是正在运行的一小段程序和数据
考题
单选题采用组相联映像的Cache存储器,为提高其等效性访问速度应()。A
增大主存容量(Cache大小不变)B
增加Cache的块数(块的大小不变)C
减小组的大小(块的大小不变)D
减小块的大小(组的大小不变)
考题
问答题假定某计算机的CPU主频为80MHz,CPI为4,并且平均每条指令访存1.5次,主存与Cache之间交换的块大小为16B,Cache的命中率为99%,存储器总线宽度为32位。请回答下列问题。 (1)该计算机的MIPS数是多少?平均每秒Cache缺失的次数是多少?在不考虑DMA传送的情况下,主存带宽至少达到多少才能满足CPU的访存要求? (2)假定在Cache缺失的情况下访问主存时,存在0.0005%的缺页率,则CPU平均每秒产生多少次缺页异常?若页面大小为4KB,每次缺页都需要访问磁盘,访问磁盘时DMA传送采用周期挪用方式,磁盘I/O接口的数据缓冲寄存器为32位,则磁盘I/O接口平均每秒发出的DMA请求次数至少是多少? (3)CPU和DMA控制器同时要求使用存储器总线时,哪个优先级更高?为什么? (4)为了提高性能,主存采用4体交叉存储模式,工作时每1/4个存储周期启动一个体。若每个体的存储周期为50ns,则该主存能提供的最大带宽是多少?
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