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有10条地址线的半导体存储芯片，若采用矩阵译码方式，则有（）条储单元选择控制线。

A．1024

B．2048

C．32

D．64

参考答案和解析
多
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考题 下面说法中正确的是()。A、部分译码方式时，存储器芯片中的一个存储单元有唯一地址。B、线选方式时存储器芯片中的一个存储单元有多个地址。地址不可能不连续。需要译码。C、全译码方式是指存储器芯片中的每一个存储单元对应一个唯一的地址。D、DMA方式与中断方式传输数据的方法是一样的。
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考题 存储芯片内的地址译码有线性译码和【 】两种方式。
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考题 设存储器的地址线有15条，存储单元为字节，采用2K×4位芯片，按全译码方法组成存储器，当该存储器被扩充成最大容量时，需要此种存储芯片的数量是( )。A．16片B．32片C．64片D．128片
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考题 设存储器的地址线有16条，基本存储单元为字节，若采用2K×4位芯片，按全译码方法组成按字节编址的存储器，当该存储器被扩充成最大容量时，需要此种存储2S芯片的数量是【 】片。
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考题 DRAM中的存储单元是以矩阵形式组织的，通过行地址和列地址经译码后访问矩阵中的某个存储单元。一个有9根地址线、行地址与列地址复用的DRAM芯片，能访问的存储单元数目是A．29个B．(29+29)个C．(29×29)个D．(9×9)个
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考题 存储器组成中，若某块存储芯片采用部分译码法，有2条地址线未使用，则该存储芯片中的每个单元有A.1个地址号B.2个地址号C.3个地址号D.4个地址号
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考题 某256×1位的存储芯片内部结构为16×16的存储元矩阵，且采用“重合法”的译码驱动方式来选择存储元，则该芯片引脚中地址线的数目为()。A.256 B.32 C.16 D.8
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考题 在统一编址的方式下，区分存储单元和I/O设备是靠()。A.不同的地址码 B.不同的地址线 C.不同的控制线 D.不同的数据线
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考题 动态存储器的刷新是按（）（填行或列）进行；若存储单体的容量为64K，采用双译码且地址线平均送到两个译码器中，则刷新地址计数器的模为（）。
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考题 若存储体中有1K个存储单元，采用双译码方式时要求译码输出线为（）A、64B、32C、560D、9
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考题 I/O编址方式为统一编址时，存储单元和I/O设备是靠（）来区分的。A、不同的地址线B、不同的地址码C、不同的控制线D、都不对
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考题 半导体存储器芯片的译码驱动方式有几种？
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考题 设某系统的CPU有地址线16条，连接了4K ROM和1K RAM。已知ROM用8708芯片（1024×8），RAM用2114芯片（1024×4）。若用高位地址线全译码输出作为各芯片的选片信号，最高地址的4条输出线接ROM，最低地址的输出线接RAM，则各片的地址范围是多少？ 
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考题 设某系统有20条地址线，现欲以4K×1b的RAM芯片构成64KB的存储系统，试问：需要（）片这样的芯片。用全译码方式进行地址译码，参与片外译码的地址线是（）条。
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考题 某半导体静态存储器芯片的地址线为A12-AO，数据线为D3~DO，若组成容量为64KB存储器，需要该种存储芯片的片数为（）A、16片B、8片C、4片D、2片
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考题 2048×8位的存储芯片，地址线和数据线各有几位，有多少个基本存储单元？
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考题 单选题已知某半导体存储芯片的地址线为12根，则此存储器的存储容量为（）A 512KBB 1024KBC 2048KBD 4096KB
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考题 单选题内存容量为16KB的存储芯片，数据线8条，地址线为（）A 13条B 14条C 15条D 16条
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考题 单选题若存储体中有1K个存储单元，采用双译码方式时要求译码输出线为（）A 64B 32C 560D 9
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