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MCS-51单片机的4个并行I/O端口作为通用I/O端口使用，在输出数据时，必须外接上拉电阻的是（）。
A．P0口
B．P1口
C．P2口
D．P3口
参考答案和解析
P0
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考题
I/O端口的编址方法有二种：即I/O端口单独编址方式和UO端口与存储器单元统一编址方式。在某个计算机系统中，内存与I/O是统一编址的，要靠(11)区分和访问内存单元和I/O设备。A．数据总线上输出的数据B．不同的地址代码C．内存与I/O设备使用不同的地址总线D．不同的指令
考题
下面关于S3C2410嵌入式微处理器芯片GPIO端口的叙述中，错误的是（）。A.GPIO端口有GPA/GPB/GPC/GPD共4个并行I/O接口B.GPIO端口的多个并行I/O接口中，有的接口的功能是单一的，有的接口的功能是复用的C.GPIO端口的每个并行I/O接口都有控制寄存器、数据寄存器以及上拉寄存器D.GPIO端口属于芯片内部的低带宽组件
考题
下面关于S3C2410嵌入式微处理器芯片GPIO端口的叙述中，错误的是：（）。A.GPIO端口有GPA/GPB/GPC/GPD/GPE/GPF/GPG/GPH多个并行I/O接口B.GPIO端口中有的I/O接口的功能是复用的，例如可以作为外部中断C.GPIO端口中的每个并行I/O接口中的上拉寄存器决定该接口引脚是否要被内部上拉D.GPIO端口属于芯片内部的高带宽组件
考题
以下对I/O超级芯片的说法不正确的是( )A．大多数超级I/O芯片中至少包括软盘控制器、双串行端口控制器、并行端口控制器三个部分B．大多数超级I/O芯片为每一个端口提供一个带缓冲器的通用异步收发器UARTC．I/O芯片中的高速多模式并行端口一般有4种模式：标准(双向)、增强并行端口 (EPP)、增强性能端口(ECP)和增强并行、性能端口(ECP/EPP)D．随着芯片的集成规模越来越大以及基于USB接口的外设逐渐取代标准串、并行和软驱控制器，超级I/O芯片将会在未来的主板上消失
考题
当STM32的I/O端口配置为输入时，输出缓冲器被禁止，施密特触发输入被激活。根据输入配置（上拉，下拉或浮动）的不同，该引脚的弱上拉和下拉电阻被连接。出现在I/O脚上的数据在每个APB2时钟被采样到输入数据寄存器，对输入（）的读访问可得到I/O状态。
考题
有关I/O端口的描述不正确的是（）A、I/O端口从逻辑上讲是被CPU访问的寄存器B、从连接形式上讲，I/O端口总是与总线连接C、一般对I/O端口的访问只能通过专用的指令D、I/O端口可以看作是CPU与外设交换数据的中转站
考题
单选题下列关于8051单片机的端口叙述正确的是（）A
P0端口是三态双向端口，称为数据总线端口B
P1端口是一个8位的准双向数据端口C
P2端口是8位准双向端口，作通用I/O端口使用D
P3端口是8位准双向I/O端口，作为高位地址线使用
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