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（）的根本任务是把时钟脉冲按一定顺序分配，形成时序脉冲。
参考答案
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考题
时序逻辑电路的波形图是（）。A、各个触发器的输出随时钟脉冲变化的波形B、各个触发器的输入随时钟脉冲变化的波形C、各个门电路的输出随时钟脉冲变化的波形D、各个门的输入随时钟脉冲变化的波形
考题
时序逻辑电路分为同步时序逻辑电路和异步时序逻辑电路两种它们的区别是（）。A、同步时序逻辑电路状态的变化与时钟脉冲同步，而异步时序电路中没有统一的时钟脉冲，电路的状态随输入信号的改变而相应改变。B、异步时序电路的每个状态都是“稳定状态”，而同步时序逻辑电路的状态分为“稳定”和“不稳定“两种。C、同步时序电路中，任一时刻，几个输入变量可以同时变化。D、异步时序电路中，每个时刻仅允许一个输入信号发生变化，以避免电路中可能出现的竞争现象。
考题
多选题时序逻辑电路分为同步时序逻辑电路和异步时序逻辑电路两种它们的区别是（）。A同步时序逻辑电路状态的变化与时钟脉冲同步，而异步时序电路中没有统一的时钟脉冲，电路的状态随输入信号的改变而相应改变。B异步时序电路的每个状态都是“稳定状态”，而同步时序逻辑电路的状态分为“稳定”和“不稳定“两种。C同步时序电路中，任一时刻，几个输入变量可以同时变化。D异步时序电路中，每个时刻仅允许一个输入信号发生变化，以避免电路中可能出现的竞争现象。
考题
单选题下列有关处理器时钟脉冲信号的叙述中，错误的是（ ）。A
时钟脉冲信号由机器脉冲源发出的脉冲信号经整形和分频后形成B
时钟脉冲信号的宽度称为时钟周期，时钟周期的倒数为机器主频C
时钟周期以相邻状态单元间组合逻辑电路的最大延迟为基准确定D
处理器总是在每来一个时钟脉冲信号时就开始执行一条新的指令
考题
填空题（）的根本任务是把时钟脉冲按一定顺序分配，形成时序脉冲。
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