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填空题
构成一个六进制计数器最少要采用()位触发器,这时构成的电路有6个有效状态,2个无效状态。

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考题 4个D触发器组成10进制计数器:() A、有效状态数有10个B、无效状态数有10个C、有效状态数有6个D、无效状态数有6E、总状态数有16个

考题 构成一个7进制计数器需要3个触发器。()

考题 要构成5进制计数器,至少需要()个触发器。 A、0B、1C、2D、3

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考题 构成一个7进制计数器需要三个触发器。() 此题为判断题(对,错)。

考题 由n位触发器构成的扭环形计数器,其无关状态数有(24)个。A.2n-nB.2nC.2n-2nD.2n-1

考题 试用上升沿D触发器构成异步3位二进制加法计数器,要求画出逻辑电路图,以及计数器输入时钟CLK与D触发器输出端Q2~Q0的波形图。

考题 试用上升沿JK触发器构成同步3位二进制加法计数器,要求画出逻辑电路图。

考题 图示时序逻辑电路是一个(  )。 附:触发器的逻辑状态表为: A. 循环左移寄存器 B. 循环右移寄存器 C. 三位同步二进制计数器 D. 异步三进制计数器

考题 图示时序逻辑电路是一个(  )。 附:触发器的逻辑状态表为: A、左移寄存器 B、右移寄存器 C、异步三位二进制加法计数器 D、同步六进制计数器

考题 采用中规模加法计数器74LS161构成的电路如图所示,该电路构成几进制加法计数器(  )。 A. 九进制 B. 十进制 C. 十二进制 D. 十三进制

考题 某时序电路的状态图如题图所示,则其为下列哪种电路?(  ) A. 五进制计数器 B. 六进制计数器 C. 环形计数器 D. 移位寄存器

考题 由四位二进制同步计算器74161构成的逻辑电路如图所示,该电路的逻辑功能 为( )。 A.同步256进制计数器 C.同步217进制计数器 B.同步243进制计数器 D.同步196进制计数器

考题 图所示逻辑电路,设触发器的初始状态均为0,当 时,该电路实现的逻辑功能是(  )。 A.同步十进制加法计数器 B.同步八进制加法计数器 C.同步六进制加法计数器 D.同步三进制加法计数器

考题 图所示逻辑电路,设触发器的初始状态均为“0”。当RD=1时,该电路的逻辑功能为(  )。 A.同步八进制加法计数器 B.同步八进制减法计数器 C.同步六进制加法计数器 D.同步六进制减法计数器

考题 采用中规模加法计数器74LS161构成的计数器电路如图所示,该电路的进制为(  )。 A. 十一进制 B. 十二进制 C. 八进制 D. 七进制

考题 图示的74LS161集成计数器构成的计数器电路和74LS290集成计数器构成的计数器电路是实现的逻辑功能依次是(  )。 A. 九进制加法计数器,七进制加法计数器 B. 六进制加法计数器,十进制加法计数器 C. 九进制加法计数器,六进制加法计数器 D. 八进制加法计数器,七进制加法计数器

考题 与非门构成的基本RS触发器,S端为0,R端为1,这时RS触发器状态为:1。

考题 凡具有两个稳定状态的器件都可构成二进制计数器。

考题 电路中各触发器状态改变有先有后是异步的,用它作成的计数器是()。A、同步计数器B、异步计数器C、二进制计数器D、四进制计数器

考题 n个触发器构成的扭环计数器中,无效状态有()个。A、nB、2nC、2n-1D、2n-2n

考题 组合逻辑电路是由()构成。A、门电路B、触发器C、门电路和触发器D、计数器

考题 n级触发器构成的环形计数器,其有效循环的状态数为()A、n个B、2n个C、2n-1个

考题 计数器可用触发器构成,()JK触发器可以构成一个十进制计数器。A、2个B、4个C、5个D、10个

考题 关于扭环形计数器下面说法正确的是()A、三个触发器构成扭环形计数器有效状态可以达到6位B、相同位数扭环形计数器与环形计数器比较有效状态增加了一倍C、相同位数扭环形计数器与环形计数器比较有效状态增加了二倍D、相同位数扭环形计数器与环形计数器比较有效状态一样E、相同位数扭环形计数器与环形计数器比较有效状态减少了一倍

考题 判断题使用3个触发器构成的计数器最多有8个有效状态。A 对B 错

考题 单选题电路中各触发器状态改变有先有后是异步的,用它作成的计数器是()。A 同步计数器B 异步计数器C 二进制计数器D 四进制计数器