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判断题
当程序有高度的顺序性时，Cache更为有效。
A
对
B
错
参考答案
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解析：
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考题
PC中CPU执行MOV指令从存储器读取数据时，数据搜索的顺序是( )A．L1 cache、12 cache、DRAM和外设B．L2 cache、L1 cache、DRAM和外设C．DRAM、外设、L2cache和L1 cacheD．外设、DRAM、L1 cache和L2 cache
考题
下列关于存储器读写速度的顺序，正确的是（ ）。A．RAM＞Cache＞硬盘＞软盘B．Cache＞RAM＞硬盘＞软盘 _C．Cache＞硬盘＞RAM＞软盘D．RAM＞硬盘＞软盘＞Cache
考题
在多级存储系统中，Cache处在CPU和主存之间，解决(55)问题。若Cache和主存的存取时间分别为T1和T2，Cache的命中率为H，则该计算机实际存取时间为(56)。当CPU向存储器执行读操作时，首先访问Cache，若命中，则从Cache中取出指令或数据，否则从主存中取出，送(57)：当CPU向存储器执行写操作时，为了使Cache的内容和主存的内容保持一致，若采用(58)法，则同时写入Cache和主存。由于Cache容量比主存容量小，因此当Cache满时，执行把主存信息向Cache写入，就要淘汰Cache中已有的信息，为了提高Cache的命中率，采用一种(59)替换算法。A．主存容量扩充B．主存和CPU速度匹配C．多个请求源访问主存D．BIOS存放
考题
使用Cache改善系统性能的依据是程序的局部性原理。程序中大部分指令是（ ）的。设某计算机主存的读／写时间为100ns，有一个指令和数据合一的Cache，已知该Cache的读／写时间为10ns，取指令的命中率为98%，取数的命中率为95%。在执行某类程序时，约有1/5指令需要额外存／取一个操作数。假设指令流水线在任何时候都不阻塞，则设置Cache后，每条指令的平均读取时间约为（ ）ns。A.顺序存储、顺序执行 B.随机存储、顺序执行 C.顺序存储、随机执行 D.随机存储、随机执行 A.12.3 B.14.7 C.23.4 D.26.3
考题
以下关于cache的叙述中，正确的有（ ）。A.cache和主存都用半导体芯片作为存储介质，因此它们的存取速度相差不大
B.在程序中不能用数据传送指令cache中某个单元中存储的内容
C.cache存储容量的大小对计算机的运行速度会产生影响
D.只有将一个程序的全部指令从内存装入cache才能在CPU中运行该程序
考题
使用 Cache 改善系统性能的依据是程序的局部性原理。程序中大部分指令是（60）的。设某计算机主存的读／写时间为 100ns，有一个指令和数据合一的 Cache，已知该 Cache的读／写时间为 10ns，取指令的命中率为 98%，取数的命中率为 95%。在执行某类程序时，约有 1/5 指令需要额外存／取一个操作数。假设指令流水线在任何时候都不阻塞，则设置 Cache 后，每条指令的平均读取时间约为（61）ns。A.顺序存储、顺序执行
B.随机存储、顺序执行
C.顺序存储、随机执行
D.随机存储、随机执行
考题
下面关于Cache的叙述，错误的是（）A、高速缓冲存储器简称CacheB、Cache处于主存与CPU之间C、程序访问的局部性为Cache的引入提供了理论依据D、Cache的速度远比CPU的速度慢
考题
当第一次访问一个块时，该块不在Cache中，需从下一级存储器中调入Cache，这就是（）失效，也叫（）失效；如果程序执行时所需的块不能全部调入Cache中，则当某些块被替换后，若又重新被访问，就会发生失效，这种失效称为（）失效。
考题
对于Cache的两种写策略，执行“写”操作时，只写入Cache，仅当Cache中相应的块被替换时，才写回主存，称为（）。执行“写”操作时，不仅写入Cache，而且也写入下一级存储器，称为（）。
考题
填空题对于Cache的两种写策略，执行“写”操作时，只写入Cache，仅当Cache中相应的块被替换时，才写回主存，称为（）。执行“写”操作时，不仅写入Cache，而且也写入下一级存储器，称为（）。
考题
填空题当第一次访问一个块时，该块不在Cache中，需从下一级存储器中调入Cache，这就是（）失效，也叫（）失效；如果程序执行时所需的块不能全部调入Cache中，则当某些块被替换后，若又重新被访问，就会发生失效，这种失效称为（）失效。
考题
填空题当发生写失效时，是否调入相应的块到Cache中，有两种不同的选择；写回法Cache一般采用（），而写直达法一般采用（）。
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