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逻辑电路如图所示，A=“1”时，C脉冲来到后D触发器（　　）。

A．具有计数器功能
B．置“0”
C．置“1”
D．无法确定

参考答案

参考解析
解析：D触发器的逻辑关系式为，
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考题 三相六拍脉冲分配逻辑电路由FFl、FF2、FF3三位JK触发器组成。() 此题为判断题(对，错)。
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考题 设脉冲上升沿触发的JK触发器Qn=0,J=1,当cp上升来到时Qn＋1为 ( ) A.1B.0C.保持D.不定态
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考题 逻辑电路如图所示，A=“0”时，C脉冲来到后，JK触发器应： A.具有计数功能 B.置“0” C.置“1” D.保持不变
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考题 逻辑电路如图所示，当A=“0”，B=“1”时，C脉冲来到后，D触发器应( )。 A.具有计数功能 B.保持原状态 C.置“0” D.置“1”
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考题 在图示逻辑电路中，触发器的初始状态是“1”态，当RD端保持高电平，在SD端加一负脉冲时，触发器的新态是( )。 A.翻转到“0”态 B.保持“1”态 C.先翻转到“0”，马上回到“1”态 D.无规律翻转不能确定
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考题 逻辑电路如图所示，A=“1”时，C脉冲来到后D触发器（　　）。 A．具有计数器功能 B．置“0” C．置“1” D．无法确定
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考题 逻辑电路如图所示，A=“1”时，C脉冲来到后，D触发器应： A.具有计数器功能 B.置“0” C.置 “1” D.无法确定
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考题 D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲cp的作用下，输出Q为： A.1 B.cp C.脉冲信号，频率为时钟脉冲频率的1/2 D.0
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考题 图示逻辑电路，当A＝1，B＝0时，则CP脉冲来到后D触发器状态是（　　）。 A． 保持原状态 B． 具有计数功能 C． 置“0” D． 置“1”
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考题 图所示逻辑电路，当A＝0，B＝1时，CP脉冲到来后D触发器（　　）。 A．保持原状态 B．置0 C．置1 D．具有计数功能
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考题 D触发器的应用电路如图所示，设输出Q的初值为0，那么，在时钟脉冲CP的作用下，输出Q为: A. 1 B. CP C.脉冲信号，频率为时钟脉冲频率的1/2 D.0
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考题 三相六拍脉冲分配逻辑电路由FFl、FF2、FF3三位（）触发器组成。A、DB、JKC、RSD、脉冲
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考题 同步时序逻辑电路中各触发器的时钟脉冲CP是同一个信号。
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考题 异步时序逻辑电路中各触发器状态变化不是发生在同一时刻，但必须要有时钟脉冲。
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考题 T触发器，在T=1时，时钟脉冲一旦触发，触发器就会（）A、保持原态B、置0C、置1D、翻转
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考题 下面属于组合逻辑电路的是（）A、译码器B、触发器C、加法器D、脉冲分配器
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考题 时序逻辑电路的波形图是（）。A、各个触发器的输出随时钟脉冲变化的波形B、各个触发器的输入随时钟脉冲变化的波形C、各个门电路的输出随时钟脉冲变化的波形D、各个门的输入随时钟脉冲变化的波形
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考题 一个T触发器，在T=1时，来一个时钟脉冲后，则触发器（）A、保持原态B、置0C、置1D、翻转
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考题 关于触发器，以下说法错误的（）。A、触发器是组成组合逻辑电路的基本单元B、触发器是组成时序逻辑电路的基本单元C、触发器具有记忆功能D、触发器有两个稳定状态
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