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一个含有32768个存储单元的ROM，有8个数据输出端，其地址输入端有（）个。
- A、10
- B、11
- C、12
- D、8
参考答案
更多 “一个含有32768个存储单元的ROM，有8个数据输出端，其地址输入端有（）个。A、10B、11C、12D、8” 相关考题
考题
1路—4路数据分配器有()A.一个数据输入端,两个选择控制端,四个数据输出端B.四个数据输入端,两个选择控制端,一个数据输出端C.一个数据输入端,一个选择控制端,四个数据输出端D .四个数据输入端,一个选择控制端,一个数据输出端
考题
下面说法中正确的是()。A、部分译码方式时，存储器芯片中的一个存储单元有唯一地址。B、线选方式时存储器芯片中的一个存储单元有多个地址。地址不可能不连续。需要译码。C、全译码方式是指存储器芯片中的每一个存储单元对应一个唯一的地址。D、DMA方式与中断方式传输数据的方法是一样的。
考题
数据选择器又称多路选择器(Multiplexer,简称MUX),它有()位地址输入、()位数据输入、1位输出。每次在地址输入的控制下,从多路输入数据中选择一路输出,其功能类似于一个单刀多掷开关,常用的数据选择器有()、()、()、()等。
考题
RAM的基本结构包含地址译码器、存储矩阵和读写电路三大部分。一个RAM芯片有11个地址输入端，8个数据输出端，则该RAM芯片的容量是（ ）位。A．88
B．880
C．211×8
D．28×11
考题
设某系统的CPU有地址线16条，连接了4K ROM和1K RAM。已知ROM用8708芯片（1024×8），RAM用2114芯片（1024×4）。若用高位地址线全译码输出作为各芯片的选片信号，最高地址的4条输出线接ROM，最低地址的输出线接RAM，则各片的地址范围是多少？
考题
已知有16K×1的DRAM芯片，其引脚功能如下：地址输入A6～A0，行地址选择RAS，列地址选择CAS，数据输入端DIN，数据输出端DOUT，控制端WE。请用给定芯片构成256KB的存储器，采用奇偶校验。试问：若芯片内部采用128×128矩阵排列，求异步刷新时该存储器的刷新间隔。
考题
问答题已知有16K×1的DRAM芯片，其引脚功能如下：地址输入A6～A0，行地址选择RAS，列地址选择CAS，数据输入端DIN，数据输出端DOUT，控制端WE。请用给定芯片构成256KB的存储器，采用奇偶校验。试问：需要芯片的总数是多少？
考题
问答题有容量为256×4，64K×1，1M×8，128K×16为的ROM，试分别回答： （1）这些ROM有多少个基本存储单元？ （2）这些ROM每次访问几个基本存储单元？ （3）这些ROM个有多少个地址线？
考题
问答题某ROM芯片中有12根地址输入端和8个数据输出端，该芯片的存储容量是多少位？
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