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问答题
有容量为256×4，64K×1，1M×8，128K×16为的ROM，试分别回答： （1）这些ROM有多少个基本存储单元？ （2）这些ROM每次访问几个基本存储单元？ （3）这些ROM个有多少个地址线？
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考题
●某嵌入式系统主存容量为64KB，其中ROM区为4KB，其余为RAM区,按字节编址。现要用2K×8位的ROM芯片和4K×4位的RAM芯片来设计该存储器,则需要上述规格的ROM芯片数和RAM芯片数分别是(47).(47) A.1、15B.2、15C.1、30D.2、30
考题
●设有二维数组a[1..m,1..n](2mn），其第一个元素为a[1,1]，最后一个元素为a[m,n]，若数组元素以行为主序存放，每个元素占用k个存储单元(k1)，则元素a[2,2]的存储位置相对于数组空间首地址的偏移量为(35)。A.(n+1)*kB.n*k+lC.(m+1)*kD.m*k+l
考题
μPD424256的容量为256K×4bit，即芯片内部有256K个存储单元，每个存储单元可存储4位信息。下面关于μPD424256的叙述中，正确的是( )。A．芯片内部有256K个存储单元，因此芯片有18个地址引脚B．芯片的RAS和CAS选通信号主要用于DRAM的刷新C．芯片的数据线有4根，但为减少芯片的引脚数，它们与18个地址信号中的低4位地址线是分时复用的D．DRAM芯片中的存储单元除像μPD424256那样存储4位信息外，有的DRAM芯片中的存储单元存储1位信息，有些存储8位信息
考题
用64K×8的RAM芯片和32K×16的ROM芯片设计一个256K×16的存储器，地址范围为00000H～3FFFFH，其中ROM的地址范围为10000H～1FFFFH，其余为RAM的地址。则地址线为(1)根，数据线为(2)根；ROM需要(3)片，RAM需要(4)片。CPU执行一段程序时，Cache完成存取的次数为5000次，主存完成存取的次数为200次。已知Cache的存取周期为40ns，主存的存取周期为160ns。其两级存储器的平均访问时间为(5)ns。A．18B．9C．16D．8
考题
现有容量为256BX4的RAM，回答案：(1)该RAM应有多少条地址线？(2)该RAM含有多少个字？其字长是多少位？( )A.8，256，4
B.8，256，8
C.4，256，8
D.8，128
考题
现有容量为256BX4的RAM，回答以下问题：(1)该RAM有多少个存储单元？(2)访问该RAM时，每次会选中几个存储单元？( )A.1024，4
B.1000，4
C.1024，2
D.1024，8
考题
某计算机系统采用页式存储管理方案，假设其地址长度为32位，其中页号占18位，页内地址占14位。系统中页面总数与页面大小分别为（ ）A.16M，256M
B.16K，512K
C.256K，16K
D.256M，16M
考题
现有如下存储芯片：2K×1的ROM、4K×1的RAM、8K×1的ROM。若用它们组成容量为16KB的存储器，前4KB为ROM，后12KB为RAM ，CPU的地址总线16位。各种存储芯片分别用多少片？
考题
设某系统的CPU有地址线16条，连接了4K ROM和1K RAM。已知ROM用8708芯片（1024×8），RAM用2114芯片（1024×4）。若用高位地址线全译码输出作为各芯片的选片信号，最高地址的4条输出线接ROM，最低地址的输出线接RAM，则各片的地址范围是多少？
考题
问答题现有如下存储芯片：2K×1的ROM、4K×1的RAM、8K×1的ROM。若用它们组成容量为16KB的存储器，前4KB为ROM，后12KB为RAM ，CPU的地址总线16位。各种存储芯片分别用多少片？
考题
问答题现有如下存储芯片：2K×1的ROM、4K×1的RAM、8K×1的ROM。若用它们组成容量为16KB的存储器，前4KB为ROM，后12KB为RAM ，CPU的地址总线16位。指出有无地址重叠现象。
考题
问答题下列容量的ROM芯片除电源和地线，还有多少个输入引脚和输出引脚？写出信号名 称。 （1）64×4 （2）512×8 （3）128K×8 （4）16K×8 （5）1M×16
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