2、若写时钟50MHz，读时钟40MHz，如果不丢失地将10万个数据送入读时钟域下游节点，则FIFO深度应设置为多少？

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2、若写时钟50MHz，读时钟40MHz，如果不丢失地将10万个数据送入读时钟域下游节点，则FIFO深度应设置为多少？

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