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要组成15进制计数器，只需要采用3个触发器

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考题 把一个5进制计数器与一个10进制计数器串联可得到15进制计数器。()
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考题 构成一个7进制计数器需要3个触发器。()
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考题 设计一个十五进制计数器,最少需要触发器的个数是() A. 2个B. 4个C. 8个D. 15个
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考题 若希望采用触发器设计一个六进制同步计数器,故需要()个触发器。 A、3B、2C、6D、4
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考题 要构成5进制计数器,至少需要()个触发器。 A、0B、1C、2D、3
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考题 采用二进制计数器可以实现模为m的计数器,其中m小于等于2k,k是触发器的个数。() 此题为判断题(对，错)。
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考题 构成同步二进制计数器一般应选用的触发器是A、D触发器B、R-S触发器C、J-K触发器D、T触发器
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考题 试用4个D触发器组成自启动4进制环行计数器。
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考题 试用 74LS160采用反馈清零法组成七进制计数器。
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考题 用JK触发器搭12进制计数器，最少需要( )个JK触发器。A、12 B、6 C、4 D、3
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考题 图所示逻辑电路，设触发器的初始状态均为0，当 时，该电路实现的逻辑功能是（　　）。 A．同步十进制加法计数器 B．同步八进制加法计数器 C．同步六进制加法计数器 D．同步三进制加法计数器
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考题 图所示逻辑电路，设触发器的初始状态均为“0”。当RD＝1时，该电路的逻辑功能为（　　）。 A．同步八进制加法计数器 B．同步八进制减法计数器 C．同步六进制加法计数器 D．同步六进制减法计数器
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考题 异步二进制计数器基本计数单元是（）A、T触发器B、计数触发器C、RS触发器D、D触发器
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考题 要把不规则的脉冲信号变换成等宽等幅的脉冲信号，应采用（）。A、十进制计数器B、单稳态触发器C、施密特触发器D、石英晶体多谐振荡器
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考题 电路中各触发器状态改变有先有后是异步的，用它作成的计数器是（）。A、同步计数器B、异步计数器C、二进制计数器D、四进制计数器
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考题 二进制异步减法计数器的接法必须把低位触发器的Q端与高位触发器的CP端相连。
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考题 根据组成计数器的各触发器状态翻转的时间与CP的关系分类，计数器可分（）计数器。A、加法、减法及加减可逆B、同步和异步C、二、十和N进制D、摩尔型和米里型
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考题 什么是二进制计数器？用4个触发器组成的二进制计数器能计多少个数？
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考题 某计数器最大输入脉冲数为15，组成该计数器所需最少的触发器个数为（）。A、2B、3C、4D、15
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考题 将Tˊ触发器一级一级地串联起来，就可以组成一个异步二进制加法计数器。
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考题 用触发器组成12进制数计数器，至少应用触发器的个数为（）个。A、2B、3C、4D、5
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考题 计数器可用触发器构成，（）JK触发器可以构成一个十进制计数器。A、2个B、4个C、5个D、10个
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考题 异步二进制计数器基本计数单元是（）。A、T触发器B、计数触发器C、JK触发器D、D触发器E、RS触发器
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考题 集成二--十进制计数器可以组成任意进制计数器。
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考题 若要产生振荡频率高度稳定的矩形波，应采用（）。A、十进制计数器B、单稳态触发器C、施密特触发器D、石英晶体多谐振荡器
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考题 单选题用触发器组成12进制数计数器，至少应用触发器的个数为（）个。A 2B 3C 4D 5
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考题 填空题构成一个六进制计数器最少要采用（）位触发器，这时构成的电路有6个有效状态，2个无效状态。
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考题 单选题电路中各触发器状态改变有先有后是异步的，用它作成的计数器是（）。A 同步计数器B 异步计数器C 二进制计数器D 四进制计数器
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