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CMOS逻辑门输出高电平、低电平的典型值为 VDD和 。
参考答案和解析
4.6V
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考题
供电电压相同时,CMOS电路与TTL电路输出的高电平与低电平的情况为()A、CMOS的输出高电平比TTL的输出高电平高,低电平比TTL输出的低电平低B、CMOS的输出高电平比TTL的输出高电平高,低电平比TTL输出的低电平高C、CMOS的输出高电平比TTL的输出高电平低,低电平比TTL输出的低电平低D、CMOS的输出高电平比TTL的输出高电平低,低电平比TTL输出的低电平高
考题
8086执行OUTDX,AL指令时其引脚()。A、M/IO输出高电平、WR输出高电平B、M/iO输出低电平,RD输出低电平C、M/IO输出低电平、WR输出低电平D、M/IO输出高电平、RD输出高电平
考题
单选题供电电压相同时,CMOS电路与TTL电路输出的高电平与低电平的情况为()A
CMOS的输出高电平比TTL的输出高电平高,低电平比TTL输出的低电平低B
CMOS的输出高电平比TTL的输出高电平高,低电平比TTL输出的低电平高C
CMOS的输出高电平比TTL的输出高电平低,低电平比TTL输出的低电平低D
CMOS的输出高电平比TTL的输出高电平低,低电平比TTL输出的低电平高
考题
单选题一与门、一或门的一个输入端接低电平0,则其各自的输出为()A
均为高电平1B
均为低电平0C
与门的输出为1,或门的输出不确定D
与门的输出为0,或门的输出不确定
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