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用2片74161分别采用反馈置数法和反馈清零法构成从0开始的60进制加法计数器。


参考答案

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考题 用集成计数器构成任意进制计数器时,常用反馈归0法和反馈置数法。() 此题为判断题(对,错)。

考题 74161集成芯片,是一个()的计数器。 A、同步置数B、异步清0C、异步置数D、同步清0E、四位二进制

考题 用反馈复位法来改变由8位十进制加法计数器的模值,可以实现______模值范围的计数器. A. 1~10B. 1~16C. 1~99D. 1~100

考题 利用反馈归零法获得N进制计数器时,若为异步置零方式,则状态SN只是短暂的过渡状态,不能稳定而是立刻变为0状态。() 此题为判断题(对,错)。

考题 根据不同需要,在集成计数器芯片的基础上,通过采用()方法可以实现任意进制的计数器。 A.反馈归零法B.预置数法C.进位输出置最小数法D.进位输出置最大数法

考题 试用74LS161采用反馈置数法组成十进制计数器。

考题 试用2 片74LS161采用整体反馈清零法组成128进制计数器。

考题 试用2片74LS161采用整体反馈置数法组成128进制计数器。

考题 试用 74LS160采用反馈清零法组成七进制计数器。

考题 用同步状态译码预置数法构成M进制加法计数器,若预置数据为0,则应将什么所对应的状态译码后驱动预置数控制端?( )A.M B.M-l C.M+l

考题 图示的74LS161集成计数器构成的计数器电路和74LS290集成计数器构成的计数器电路是实现的逻辑功能依次是(  )。 A. 九进制加法计数器,七进制加法计数器 B. 六进制加法计数器,十进制加法计数器 C. 九进制加法计数器,六进制加法计数器 D. 八进制加法计数器,七进制加法计数器

考题 集成计数器40192具有()功能。A、异步清零B、并行置数C、加法计数D、减法计数E、同步清零

考题 时序逻辑电路的计数器直接取相应进制数经相应门电路送到()端。A、异步清零端B、同步清零端C、异步置数端D、同步置数端

考题 时序逻辑电路的计数器取相应进制数少一经相应门电路送到()端。A、异步清零端B、同步清零端C、异步置数端D、同步置数端

考题 集成二--十进制计数器通过反馈置数及反馈清零法计数。

考题 利用反馈归零法获得N进制计数器时,若为异步置零方式,则状态SN只是短暂的过渡状态,不能稳定而是立刻变为0状态。

考题 用集成计数器设计n进制计数器时,一般采用()。A、置最小数法B、反馈复位法C、反馈预置D、时钟禁止

考题 用集成计数器设计n进制计数器时,不宜采用()方法。A、置最小数B、反馈复位C、反馈预置D、时钟禁止

考题 用二进制异步计数器从0做加法,计到十进制数178,则最少需要()个触发器。A、1B、6C、8D、10

考题 用反馈复位法来改变由8位二进制加法计数器的模值,可以实现()模值范围的计数器。A、1-~15B、1~16C、1~32D、1~256

考题 集成计数器40192具有()功能。A、异步清零B、并行置数C、加法计数D、减法计数E、脉冲输出

考题 时序逻辑电路的计数器直接取相应的进制数相应门电路送到()端。A、异步清零端B、同步清零端C、异步置数端D、同步置数端

考题 填空题74LS161是一个()个管脚的集成计数器,用它构成任意进制的计数器时,通常可采用()和反馈预置法。

考题 多选题用集成计数器设计n进制计数器时,一般采用()。A置最小数法B反馈复位法C反馈预置D时钟禁止

考题 单选题用集成计数器设计n进制计数器时,不宜采用()方法。A 置最小数B 反馈复位C 反馈预置D 时钟禁止

考题 单选题在设计同步时序电路时,检查到不能自行启动时,则()。A 只能用反馈复位法清零B 只能用修改驱动方程的方法C 必须用反馈复位法清零并修改驱动方程D 可以采用反馈复位法(置位法),也可以采用修改驱动方程的方法保证电路能白行启动。

考题 单选题用反馈复位法来改变由8位二进制加法计数器的模值,可以实现()模值范围的计数器。A 1-~15B 1~16C 1~32D 1~256