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由M1、M2构成的二级存储体系中，若CPU访问的内容已在M1中，则其存取速度为T1；若不在M1中，其存取速度为T2。现设H为命中率(CPU能从M1中直接获取信息的比率)，则该存储体系的平均存取时间T1的计算公式是( )。
A．HT1+T2
B．(1-H)T1+HT2
C．T2-HT1
D．HT1+(1-H)T2
参考答案
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考题
在CPU和主存间设置cache存储器主要是为了(14)。若使用基于数据内容进行访问的存储设备作为cache时，能更快决定是否命中。这种地址映射方法称为(15)映射。CPU向cache执行写操作时，可以同时写回主存储器或者仅当cache中该数据被淘汰时才写回主存储器，前者称为(16)，而后者称为(17)。若cache的存取速度是主存存取速度的10倍，且命中率可达到0.8，则CPU对该存储系统的平均存取周期为(18)T(T为主有的存取周期)。A．扩充主存容量B．解决CPU和主存的速度匹配C．提高可靠性D．增加CPU访问的并行度
考题
在CPU执行一段程序的过程中，Cache的存取次数为4600次，由主存完成的存取次数为400次。若Cache的存取周期为5ns，主存的存取周期为25ns，则CPU的平均访问时间为______ns。A．5.4B．6.6C．8.8D．9.2
考题
由M1、M2构成的二级存储体系中，若CPU访问的内容已在M1中，则其存取速度为了T1；若不在M1中，其存取得的速度为T2。先设H为命中率(CPU能从M1中直接获取信息的比率)，则该存储体系的平均存取时间TA的计算公式是( )。A．HT1+T2B．(1—H)T1+HT2C．T2-HT1D．HT1+(1—H)T2
考题
在CPU执行一段程序的过程中，Cache的存取次数为4600次，由主存完成的存取次数为400次。若 Cache的存取周期为5ns，CPU的平均访问时间为6.6ns，则主存的存取周期为(3)ns。A．18.6B．21.7C．23.8D．25
考题
由M1、M2构成的二级存储体系中，若CPU访问的内容已在M1中，则其存取速度为T1；若不在M1中，其存取得的速度为T2。先设H为命中率(CPU能从M1中直接获取信息的比率)，则该存储体系的平均存取时间TA的计算公式是( )。A．HT1+T2B．(1-H)T1+HT2C．T2-HT1D．HT1+(1-H)T2
考题
在多级存储系统中，Cache处在CPU和主存之间，解决(55)问题。若Cache和主存的存取时间分别为T1和T2，Cache的命中率为H，则该计算机实际存取时间为(56)。当CPU向存储器执行读操作时，首先访问Cache，若命中，则从Cache中取出指令或数据，否则从主存中取出，送(57)：当CPU向存储器执行写操作时，为了使Cache的内容和主存的内容保持一致，若采用(58)法，则同时写入Cache和主存。由于Cache容量比主存容量小，因此当Cache满时，执行把主存信息向Cache写入，就要淘汰Cache中已有的信息，为了提高Cache的命中率，采用一种(59)替换算法。A．主存容量扩充B．主存和CPU速度匹配C．多个请求源访问主存D．BIOS存放
考题
有两种理想气体，第一种的压强记作p1，体积记作V1，温度记作T1，总质量记作m1，摩尔质量记作M1；第二种的压强记作p2，体积记作V2，温度记作T2，总质量记作m2，摩尔质量记作M2；当V1=V2,T1=T2,m1=m2时，则M1/M1为：
考题
以下关于模块耦合关系的叙述中，耦合程度最低的是__1____，其耦合类型为___2___耦合。
1、_____A.模块M2根据模块M1传递如标记量的控制信息来确定M2执行哪部分语句
B.模块M2直接访问模块M1内部
C.模块M1和模块M2用公共的数据结构
D.模块M1和模块M2有部分代码是重叠的
考题
3、假设在一个两级存储系统中， M1的访问时间为T1，命中率为H； M2的访问时间为T2，从M2传送一个信息块到M1所需的时间为TB。则整个存储系统的平均访问时间是（）。A．T1B．T2C．T1 * H + (1-H) * T2D．T1 + (1-H) * (T2+TB)
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