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利用N进制计数器构成M（N＞M）进制计数器，同步置0法用于产生置0信号的状态是（）。

A．SM-1　

B．SM-2

C．SM+1

D．SM

参考答案和解析
S N-1
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考题 74161集成芯片,是一个()的计数器。 A、同步置数B、异步清0C、异步置数D、同步清0E、四位二进制
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考题 74LS161是一个()的四位二进制加计数器。 A、同步清0，异步置数B、异步清0，同步置数C、同步清0，同步置数
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考题 利用反馈归零法获得N进制计数器时,若为异步置零方式,则状态SN只是短暂的过渡状态,不能稳定而是立刻变为0状态。() 此题为判断题(对，错)。
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考题 4LS169为一个同步四位二进制可逆计数器，有下列()说法成立。A.置输入信号UP/DN=0，则为加1计数;B.置输入信号UP/DN=0，则为减1计数;C.Rco仅为进位信号;D.计数器不能用跳跃的方法实现任意模数的计数。
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考题 用2片74161分别采用反馈置数法和反馈清零法构成从0开始的60进制加法计数器。
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考题 A.同步二进制加法计数器 B.同步四进制加法计数器 C.同步三进制计数器 D.同步三进制减法计数器
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考题 由四位二进制同步计算器74161构成的逻辑电路如图所示，该电路的逻辑功能 为（ )。 A.同步256进制计数器 C.同步217进制计数器 B.同步243进制计数器 D.同步196进制计数器
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考题 图所示逻辑电路，设触发器的初始状态均为0，当 时，该电路实现的逻辑功能是（　　）。 A．同步十进制加法计数器 B．同步八进制加法计数器 C．同步六进制加法计数器 D．同步三进制加法计数器
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考题 图所示逻辑电路，设触发器的初始状态均为“0”。当RD＝1时，该电路的逻辑功能为（　　）。 A．同步八进制加法计数器 B．同步八进制减法计数器 C．同步六进制加法计数器 D．同步六进制减法计数器
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考题 图所示电路，集成计数器74LS160在M＝1和M＝0时，其功能分别为（　　）。 A．M＝1时为六进制计数器，M＝0时为八进制计数器 B．M＝1时为八进制计数器，M＝0时为六进制计数器 C．M＝1时为十进制计数器，M＝0时为八进制计数器 D．M＝1时为六进制计数器，M＝0时为十进制计数器
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考题 用同步状态译码预置数法构成M进制加法计数器，若预置数据为0，则应将什么所对应的状态译码后驱动预置数控制端？( )A.M B.M-l C.M+l
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考题 计数器的种类繁多，按编码可分为（）。A、加法计数器B、二进制计数器C、十进制计数器D、N进制计数器
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考题 N进制计数器可以实现N分频。
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考题 将两片40193级联后用进位输出置数法构成M进制计数器，预置数端的数据N应是256-N。
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考题 利用反馈归零法获得N进制计数器时，若为异步置零方式，则状态SN只是短暂的过渡状态，不能稳定而是立刻变为0状态。
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考题 集成计数器构成N进制计数器有哪几种方法？异步计数器结构与同步计数器有何不同？
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考题 用集成计数器设计n进制计数器时，一般采用（）。A、置最小数法B、反馈复位法C、反馈预置D、时钟禁止
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考题 用集成计数器设计n进制计数器时，不宜采用（）方法。A、置最小数B、反馈复位C、反馈预置D、时钟禁止
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考题 将两片40193级联后用借位输出置数法构成M进制减法计数器，M的取值范围是（）A、0=M=100B、2=M=256C、2=M=255D、0=M=256
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考题 下面关于N进值计数器说法正确的是（）A、N进制计数器是逢N向前进位，计数位归零B、N进制计数器是逢N向前进位，计数位不归零C、实现8进制计数器最少需8位二进制位D、实现8进制计数器最少需3位二进制位E、实现16进制计数器只需1片40192即可
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考题 将两片CC40192级联后用借位输出法构成M（M=100）进制减法计数器，预置数端的数据N应是M。
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考题 集成计数器40192置数方式是（）A、同步0有效B、串行置数C、并行置数D、同步1有效
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考题 按计数器状态变化的规律分类，计数器可分为（）计数器。A、加法、减法和可逆B、同步和异步C、二、十和N进制D、一位和N位
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考题 多选题用集成计数器设计n进制计数器时，一般采用（）。A置最小数法B反馈复位法C反馈预置D时钟禁止
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考题 单选题用集成计数器设计n进制计数器时，不宜采用（）方法。A 置最小数B 反馈复位C 反馈预置D 时钟禁止
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考题 单选题二进制计数器的计数长度为16，利用置数功能，可构成长度为（）的其他进制计数器。A 小于16B 大于16C 等于16D 任意
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考题 单选题A 同步256进制计数器B 同步240进制计数器C 同步208进制计数器D 同步200进制计数器
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