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已知某64位机主存采用半导体存储器,其地址码为26位,若使用4M×8位的DRAM芯片组成该机所允许的最大主存空间,并选用内存条结构形式,问: (1)每个内存条内共有多少DRAM芯片? (2)主存共需多少DRAM芯片?


参考答案和解析
(1) 4(块)(2)32(片)(3)主存共需DRAM芯片为:4×32=128 (片)每个内存条有32片DRAM芯片,容量为16M×64位,需24根地址线(A23~A0)完成内 存条内存储单元寻址。一共有4块内存条,采用2根高位地址线(A25~A24),通过2:4译码器译码产生片选信号对各模块板进行选择。
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考题 有一个16K×16位的存储器,由1K×4位的DRAM芯片构成(芯片是64×64结构)。问:(1)共需要多少RAM芯片?(2)采用异步刷新方式,如单元刷新间隔不超过2ms,则刷新信号周期是多少(3)如采用集中刷新方式,存储器刷新一遍最少用多少读/写周期?死时间率是多少?

考题 某半导体存储器容量8K×8位,可选用的RAM芯片容量为2K×4位,回答以下问题。(1)该存储系统要采用什么形式的扩展方式?(2)总共需要多少个RAM芯片?(3)如果有一个16K×16位的存储器,用1K×4位的DRAM芯片构成,那么总共需要多少DRAM芯片?

考题 PC机的主存储器是由许多DRAM芯片组成的,目前其完成一次存取操作所用时间的单位是()。

考题 PC中既使用ROM,也使用SRAM和DRAM。下面关于ROM、SRAM和DRAM的叙述中,正确的是( )。A.SRAM和DRAM都是RAM,芯片掉电后,存放在SRAM和DRAM芯片中的内容都会丢失B.PC中CMOS RAM中的信息,在PC关机后一般也会丢失C.由于SRAM的速度比DRAM的慢,因此,在PC中,DRAM主要用作高速缓冲存储器(Cache)而内存条则由SRAM组成D.ROM和SRAM及DRAM都是半导体存储器,因此,现常用ROM代替RAM来存放原来存放在CMOS RAM中的信息

考题 PC中既使用ROM,也使用SRAM和DRAM。下面关于ROM、SRAM和DRAM的叙述中,错误的是______。A.ROM芯片掉电后,存放在芯片中的内容会丢失B.PC中CMOS RAM中的信息,在PC关机后一般不会丢失C.由于SRAM的速度比DRAM快,因此,在PC中,SRAM主要用作高速缓冲存储器(Cache)而内存条则由DRAM组成D.RAM芯片掉电后,存在芯片中的内容会丢失

考题 目前RAM多采用MOS型半导体集成电路芯片制成,PC机中使用的RAM除DRAM芯片外,还使用【 】芯片。

考题 为提高PC机主存储器的存取速度,出现了多种类型的DRAM内存条,若按存取速度从低到高排列,正确的顺序是( )。A.EDO DRAM,SDRAM,RDRAMB.EDO DRAM,RDRAM,SDRAMC.SDRAM,EDO DRAM,RDRAMD.RDRAM,DEO DRAM,SDRAM

考题 Cache存储器一般采用SRAM半导体芯片,而主存条主要由( )半导体组成。A.ROMB.PROMC.EPROMD.DRAM

考题 SRAM和DRAM各有何特点,内存条使用哪种芯片?

考题 由4M×1位DRAM存储芯片构成8M×8位高集成度的内存条,所需该存储芯片的片数为()A、4B、8C、16D、32

考题 4M×1位DRAM存储芯片需要地址总线为()条,由此种芯片构成8M×8位高集成度的内存条,所需该存储芯片的片数为()片。

考题 某微机系统的存储器地址空间为A8000H—CFFFH,若采用单片容量为16K×1位的SRAM芯片,问:系统存储容量为多少?组成该存储系统共需该类芯片多少?整个系统芯片组应为多少?

考题 有一个1024K×32位的存储器,由128K×8位的DRAM构成。问:(1)总共需要多少DRAM芯片?(2)采用异步刷新,如果单元刷新间隔不超过8ms,则刷新信号周期是多少?

考题 已知某机字长8位,现采用半导体存储器作主存,其地址线为16位,若使用1K×4的SRAM芯片组成该机所允许的最大主存空间,并采用存储模板结构形式。若每块模板容量为4K×8,共需多少块存储模板?

考题 微机大容量主存一般采用DRAM芯片组成。

考题 某机字长16位,CPU地址总线18位,数据总线16位,存储器按字编址,CPU的控制信号线有:MREQ#(存储器访问请求,低电平有效),R/W#(读写控制,低电平为写信号,高电平为读信号)。试问:【**,★,包捷5.2,编号3.3,3.5.2】 该机主存采用64K×1位的DRAM芯片(内部为4个128×128阵列)构成最大主存空间,则共需()个芯片;若采用异步刷新方式,单元刷新间隔为2ms,则刷新信号的周期为()。

考题 有一个64K×16位的存储器,由16K×1位的DRAM芯片(芯片内是128×128结构)构成,存储器读/写周期为500ns,试问: 1)需要多少片DRAM芯片? 2)采用异步刷新方式,如单元刷新间隔不超过2ms,则刷新信号周期是多少? 3)如果采用集中刷新方式,存储器刷新一遍最少用多少时间?

考题 某8位微型机地址码为18位,若使用4K×4位的RAM芯片组成模块板结构的存储器,试问:该机所允许的最大主存空间是多少?

考题 主存储器在物理结构上由若干插在主板上的内存条组成。目前,内存条上的芯片一般选用DRAM而不采用SRAM。()

考题 单选题某容量为256M的存储器,由若干4M*8位的DRAM芯片构成,该DRAM芯片的地址引脚和数据引脚总数是:()A 19B 22C 30D 36

考题 问答题某机字长16位,CPU地址总线18位,数据总线16位,存储器按字编址,CPU的控制信号线有:MREQ#(存储器访问请求,低电平有效),R/W#(读写控制,低电平为写信号,高电平为读信号)。试问:【**,★,包捷5.2,编号3.3,3.5.2】 该机主存采用64K×1位的DRAM芯片(内部为4个128×128阵列)构成最大主存空间,则共需()个芯片;若采用异步刷新方式,单元刷新间隔为2ms,则刷新信号的周期为()。

考题 填空题4M×1位DRAM存储芯片需要地址总线为()条,由此种芯片构成8M×8位高集成度的内存条,所需该存储芯片的片数为()片。

考题 判断题主存储器在物理结构上由若干插在主板上的内存条组成。目前,内存条上的芯片一般选用DRAM而不采用SRAM。()A 对B 错

考题 问答题有一个1024K×32位的存储器,由128K×8位的DRAM构成。问:(1)总共需要多少DRAM芯片?(2)采用异步刷新,如果单元刷新间隔不超过8ms,则刷新信号周期是多少?

考题 问答题某8位微型机地址码为18位,若使用4K×4位的RAM芯片组成模块板结构的存储器,试问:该机所允许的最大主存空间是多少?

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考题 问答题有一个64K×16位的存储器,由16K×1位的DRAM芯片(芯片内是128×128结构)构成,存储器读/写周期为500ns,试问: 1)需要多少片DRAM芯片? 2)采用异步刷新方式,如单元刷新间隔不超过2ms,则刷新信号周期是多少? 3)如果采用集中刷新方式,存储器刷新一遍最少用多少时间?

考题 判断题微机大容量主存一般采用DRAM芯片组成。A 对B 错